Diagrammi di temporizzazione istruzione FFL e FFU

Gli esempi di diagramma di temporizzazione seguenti descrivono scenari di esecuzione per le istruzioni FFL (caricamento FIFO) e FFU (Scarica FIFO).

Il completamento dell'esecuzione FFL seguita dal completamento dell'esecuzione FFU

Il completamento dell'esecuzione FFL seguita dal completamento dell'esecuzione FFU
Il completamento dell'esecuzione FFL seguito dal completamento dell'esecuzione FFU
Descrizione del ciclo di scansione
Ciclo di scansione
Descrizione
1
La condizione ramo diventa TRUE quando:
  • Il bit di ingresso Esegue è TRUE.
  • Dati di carico (push) allo stack FIFO.
  • Il bit di uscita Completato è TRUE.
2, 3, 4
Nessuna modifica nella condizione ramo.
5
La condizione ramo diventa FALSE quando:
  • Il bit Esegue è FALSE.
  • Il bit di uscita Completato è FALSE.
6, 7
Nessuna modifica nella condizione ramo.
  • Il bit Esegue è FALSE.
  • Il bit di uscita Completato è FALSE.
8
Il ramo passa a TRUE quando:
  • Il bit di ingresso Esegue è TRUE.
  • Scaricare i dati dallo stack FIFO.
  • Il bit di uscita Completato è TRUE.
9
Nessuna modifica nella condizione ramo.
  • Il bit Esegue è FALSE.
  • Il bit di uscita Completato è FALSE.
10, 11
Nessuna modifica nella condizione ramo.

Completamento dell'esecuzione quando il bit vuoto è TRUE

Completamento dell'esecuzione quando il bit vuoto è TRUE
Completamento dell'esecuzione quando il bit vuoto è TRUE
Descrizione del ciclo di scansione
Ciclo di scansione
Descrizione
1
La condizione ramo diventa TRUE quando:
  • Il bit di ingresso Esegue è TRUE. Avvio esecuzione.
  • La Posizione è zero. Il bit Vuoto è TRUE.
  • Il bit di uscita Completato è TRUE.
2, 3, 4
Nessuna modifica nella condizione ramo.
5
La condizione ramo diventa FALSE quando:
  • Il bit Esegue è FALSE.
  • Il bit Vuoto è TRUE.
  • Il bit di uscita Completato è FALSE.
6, 7
Nessuna modifica nella condizione ramo.
8
Il ramo passa a TRUE quando:
  • Il bit di ingresso Esegue è TRUE. Avvio esecuzione.
  • Il bit Vuoto è TRUE.
  • Il bit di uscita Completato è TRUE.
9
La condizione ramo diventa FALSE quando:
  • Il bit Esegue è FALSE.
  • Il bit Vuoto è TRUE.
  • Il bit di uscita Completato è FALSE.
10, 11
Nessuna modifica nella condizione ramo.

Completamento dell'esecuzione quando il bit vuoto è TRUE

Completamento dell'esecuzione quando il bit vuoto è TRUE
Completamento dell'esecuzione quando il bit vuoto è TRUE
Descrizione del ciclo di scansione
Ciclo di scansione
Descrizione
1
La condizione ramo diventa TRUE quando:
  • Il bit di ingresso Esegue è TRUE. Avvio esecuzione.
  • La Posizione è uguale alla Lunghezza, il bit Pieno è TRUE.
  • Il bit di uscita Completato è TRUE. 
2, 3, 4
Nessuna modifica nella condizione ramo.
5
La condizione ramo diventa FALSE quando:
  • Il bit Esegue è FALSE.
  • Il bit Pieno è TRUE.
  • Il bit di uscita Completato è FALSE.
6, 7
Nessuna modifica nella condizione ramo.
8
Il ramo passa a TRUE quando:
  • Il bit di ingresso Esegue è TRUE. Avvio esecuzione.
  • Il bit Pieno è TRUE.
  • Il bit di uscita Completato è TRUE.
9
La condizione ramo diventa FALSE quando:
  • Il bit Esegue è FALSE.
  • Il bit Pieno è TRUE.
  • Il bit di uscita Completato è FALSE.
10, 11
Nessuna modifica nella condizione ramo.

Errore durante l'esecuzione di FFL e FFU

Errore durante l'esecuzione di FFL e FFU
Errore durante l'esecuzione di FFL e FFU
Descrizione del ciclo di scansione
Ciclo di scansione
Descrizione
1
La condizione ramo diventa TRUE quando:
  • Il bit di ingresso Esegue è TRUE. Avvio esecuzione.
  • Il bit Errore è TRUE.
2, 3, 4
Nessuna modifica nella condizione ramo.
5
La condizione ramo diventa FALSE quando:
  • Il bit Esegue è FALSE.
  • I bit Error ed ErrorID sono FALSE.
6, 7
Nessuna modifica nella condizione ramo.
8
Il ramo passa a TRUE quando:
  • Il bit di ingresso Esegue è TRUE. Avvio esecuzione.
  • Il bit Errore è TRUE.
9
La condizione ramo diventa FALSE quando:
  • Il bit Esegue è FALSE.
  • I bit Error ed ErrorID sono FALSE.
10, 11
Nessuna modifica nella condizione ramo.
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